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基于Verilog的全数字锁相环的设计

刘永勤

渭南师范学院学报2010，Vol.25Issue(5)：49-51,3.
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渭南师范学院学报2010，Vol.25Issue(5)：49-51,3.

基于Verilog的全数字锁相环的设计

The Design of DPLL Based on Verilog

刘永勤1

作者信息

  • 1. 渭南师范学院,物理与电子工程系,陕西,渭南,714000
  • 折叠

摘要

关键词

全数字锁相环/Verilog/FPGA

分类

信息技术与安全科学

引用本文复制引用

刘永勤..基于Verilog的全数字锁相环的设计[J].渭南师范学院学报,2010,25(5):49-51,3.

渭南师范学院学报

OACHSSCD

1009-5128

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