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基于VHDL语言的作息时间控制器设计

林振宇 梁耀升

机电信息Issue(14)：5-6,2.
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机电信息Issue(14)：5-6,2.

基于VHDL语言的作息时间控制器设计

林振宇 1梁耀升1

作者信息

  • 1. 三峡大学电气与新能源学院,湖北宜昌443000
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摘要

关键词

EDA/VHDL语言/Quartus_Ⅱ/作息时间控制器

引用本文复制引用

林振宇,梁耀升..基于VHDL语言的作息时间控制器设计[J].机电信息,2019,(14):5-6,2.

机电信息

1671-0797

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